RISC-V-Bastelcomputer für Schüler und Developer
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SiFives "Learn Inventor" zielt mit MicroPython und Sensoren nicht nur auf Schüler, sondern mit WLAN, RTOS und JTAG auch auf IoT-Einsatz an der AWS-Cloud․

Microchip PolarFire: FPGA mit RISC-V-Kernen und Vektor-Befehlen
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Microchips FPGA PolarFire SoC hat PCIe und fünf RISC-V-Kerne für Echtzeit-Linux; andere RISC-V-Kerne rechnen schneller dank Vektor-Erweiterungen․

​​​Chris Lattner landet bei RISC-V-Unternehmen
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Der frühere Chefarchitekt der Programmiersprache Swift verlässt Google und schlägt nun als Senior Vice President of Platform Engineering bei SiFive auf․

​​​Bayrischer RISC-V-Sicherheitschip mit seL4-Microkernel
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Hensoldt Cyber entwickelt einen Chip für hohe Sicherheitsanforderungen mit RISC-V-Kernen und formal verifiziertem Microkernel․

​​​​​SiFive kündigt "PC" mit offener RISC-V-Technik an
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Das System-on-Chip SiFive Freedom U740 soll die Programmierung und Optimierung von Linux-Software für RISC-V voranbringen․

​​​​​SiFive HiFive Unmatched: RISC-V-Entwicklerboard mit 8 GByte RAM und PCIe 3․0
#LinuxundOpenSource #RISCV #SiFive

SiFive will eines der ersten Linux-tauglichen Developer-Systeme für RISC-V für unter 700 US-Dollar verkaufen․

​​​​​Mobilentwicklung: Alibaba-Tochter portiert Android auf RISC-V
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Das chinesische Unternehmen T-Head hat eine Variante von Android 10 für die offene Befehlssatzarchitektur RISC-V herausgegeben․

​​​​​Enter at Your Own RISC! – Intermezzo mit RISC-V und dem ESP32-C3
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In den letzten Folgen war vom Raspberry Pi Pico die Rede․ Bevor sich das Blog weiterhin dem Pico widmet, adressiert dieses Extra-Posting den neuen Microcontroller ESP32-C3 von Espressif․ Da der Chip auf der offenen RISC-V-Architektur basiert, geht der Artikel auch auf deren Grundlagen ein․

​​​​​Huawei: RISC-V statt ARM, um Sanktionen zu meiden
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Die Huawei-Tochter HiSilicon liefert erste RISC-V-Chips aus, die mit dem ebenfalls hauseigenen Betriebssystem HarmonyOS laufen․

​​​​​Google bekennt sich zu Android auf RISC-V-Prozessoren
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Der hochrangige Google-Manager Lars Bergstrom betont, dass das Android Open Source Project (AOSP) viel Arbeit in die Unterstützung von RISC-V-Chips steckt․

​​​​​RISE: Initiative der Linux Foundation Europe für RISC-V-Softwareentwicklung
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Der europäische Ableger der Linux Foundation will mit der Initiative RISE die Entwicklung für RISC-V-Prozessoren anschieben․ An Bord sind viele Branchengrößen․

​​​​​Wichtige ARM-Kunden gründen RISC-V-Allianz in Deutschland
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Kurz vor dem Börsengang des CPU-Entwicklers ARM gründen fünf namhafte Lizenznehmer eine Allianz, die RISC-V-Chips zunächst für Autos voranbringen soll․

​​​​​CPU-Technik RISC-V hinkt bei Rechenleistung hinterher
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Schottische Supercomputer-Experten vermessen den bisher stärksten RISC-V-Prozessor Sophon SG2042 mit 64 CPU-Kernen: Da bleibt Luft nach oben․